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华为颁发韬(τ)定律，基于该定律已设计并量产381款芯片，沈樵

新京报贝壳财经讯（记者张晓慧）5月25日，在电气电子工程师学会（IEEE）进行的国际电路系统钻研会ISCAS 2026上，华为公司董事、半导体业务部总裁何庭波颁发题为“半导体新蹊径索求与实际”的宗旨演讲，颁发了领导半导体产业发展的新准则——韬(τ)定律。

韬(τ)定律提出以“功夫(τ)缩微”代替“几何缩微”作为半导体与电子系统演进的新领导准则——通过逻辑折叠等创新技术，持续压缩信号传布时延，不休提升晶体管密度，从而实现半导体与电子系统的持续演进。

华为官网显示，华为提出“逻辑折叠(LogicFolding)”等主题技术，构建贯通器件、电路、芯片到系统层面的多层级协同优化系统。该系统以系统性降低功夫常数τ为指标，旨在驱动各层级机能、能效、晶体管密度的持续提升：器件层面，通过优化晶体管和互连电阻及寄生电容，从物理底层最大限度缩微器件级功夫常数τ
；电路层面，通过逻辑折叠技术突破传统平面布局的物理天堑，缩短关键蹊径的走线长度并有效降低信号传布的电阻和电容负载，实现晶体管密度和电路机能提升
；芯片层面，通过“软件、架构、芯片”的全栈软硬芯协同设计，基于现实工作负载实现指令流和数据流的细粒度节造，提高系统级并行度和效能，降低端到端执行功夫
；系统层面，界说灵衢总线，重构推算系统互联和谈，实现超节点的统一内存编址和原生内存语义，降低系统通讯时延。

宗旨演讲中，何庭波介绍，基于韬(τ)定律，华为已成功设计并量产了381款芯片
；将于2026年秋季面世的麒麟芯片，率先选取了逻辑折叠技术
；预计到2031年，基于韬(τ)定律的高端芯片晶体管密度将达到1.4纳米造程的一致水平。

编纂 杨娟娟

校对 赵琳